請問華為的基站控制器bsc中FPGA主要做什么工作？

因為我不太清楚具體那些地方用FPGA實現(xiàn)，希望各位能夠賜教

你先告訴我你問哪個FPGA，我就不信一BSC里面就1個FPGA

現(xiàn)場可編程門陣列，一種集成電路&#%kcvmK:JFD()本文來自移動通信網(wǎng)gg1fic3.cn,版權(quán)所有

基站發(fā)送部分。在該部分中，除了靠近發(fā)射天線的部分，其他部分都可以用FPGA實現(xiàn)。主要包括CRC、FEC、交織、正交可變擴頻因子、擾碼和QPSK調(diào) 制。CRC的實現(xiàn)可以用移位寄存器及XOR運算實現(xiàn)。FEC（前向糾錯）主要包括Viterbi和Turebo編碼兩種，它們編碼的實現(xiàn)方法也是利用移位 寄存器和XOR運算等方法實現(xiàn)。OVSF及擴頻擾碼也能很有效的用FPGA實現(xiàn)。交織可以用FPGA內(nèi)嵌MEMORY實現(xiàn)。QPSK調(diào)制包括成形濾波，插 值，NCO及乘法器及相加運算，這些非常適合用Stratix/StratixII器件實現(xiàn)，并且Altera還有現(xiàn)成的IP核和參考設計。
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　 　基站接收部分。大該部分中，同樣除靠近接收天線的部分外，都可以用FPGA實現(xiàn)。主要包括解調(diào)、RAKE接收、路徑搜索、多用戶檢測、合并及反交織、 FEC解碼和CRC校驗。解調(diào)包括NCO、成型濾波、抽取及乘法運算，這些非常適合用FPGA實現(xiàn)，而且我們有相應的IP核及參考設計。RAKE接收、路 徑搜索、多用戶檢測及合并包含了大量的相關(guān)運算，它最基本的運算也是相乘相加運算，Stratix/StratixII內(nèi)包含了大量的定制的乘法器及加減 /累加器。反交織的實現(xiàn)和交織一樣，可以用內(nèi)嵌的存儲器實現(xiàn)。FEC解碼包括Viterbi和turbo解碼，Altera也有相應的IP核。CRC校驗 和發(fā)送部分的CRC產(chǎn)生實現(xiàn)方法一樣。fjouierpoej礙:JFD()$#_*(本文來自移動通信網(wǎng)gg1fic3.cn,版權(quán)所有
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　　基站構(gòu)成部分�；�站一般由RF板、信道板、控制板、交換板、接口板及時鐘板組成。RF板上除了 完成傳統(tǒng)的射頻信號處理外，還包括數(shù)字中頻部分（數(shù)字上變頻DUC，數(shù)字下變頻DDC，數(shù)字預失真DPD，波峰因子消減CFR及其它邏輯）；信道板是基站 的核心部分，大部分數(shù)字信號的處理都是在這塊板上完成，如FEC，擴頻調(diào)制解調(diào)等；交換板完成交換功能；接口板完成與基站控制器的接口，如E1/T1接口 或STM-1光接口。21%$#(*$K:JFD()$本文來自移動通信網(wǎng)gg1fic3.cn,版權(quán)所有