問(wèn)題已開(kāi)啟
(普通問(wèn)題)
EDGE多時(shí)隙下的測(cè)試
EDGE多時(shí)隙下的開(kāi)關(guān)調(diào)制譜測(cè)試對(duì)時(shí)隙的配置有要求嗎?例如說(shuō)2上1下,是不是必須 up3,4 down3,mainslot3另一個(gè)UP時(shí)隙在主時(shí)隙之后,不能up2,3 down3,mainslot3另一個(gè)UP時(shí)隙在主時(shí)隙之前。 類(lèi)似這樣的要求有嗎?3GPP哪一份文件對(duì)此有規(guī)定嗎?求指教。 看到一份文件說(shuō)不同的class等級(jí)要選擇不同的時(shí)隙配置,如下圖 |
現(xiàn)在的問(wèn)題是900MHz 下時(shí)隙配置為up3,4 down3開(kāi)關(guān)譜就沒(méi)有問(wèn)題,如果配置成up2,3 down3就會(huì)FAIL。我傳個(gè)GIF圖,一看就很明白了。。
用的儀表是CMU200(用8960就看不出這個(gè)問(wèn)題來(lái),8960上也不可以配置時(shí)隙的順序)
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