詞語解釋
ModelSim是一款由Mentor Graphics公司開發(fā)的集成電路仿真軟件,用于模擬和驗證設計的邏輯功能,可以幫助用戶發(fā)現(xiàn)硬件設計中的錯誤,以及設計的性能和可靠性。 ModelSim的主要用途是仿真和驗證邏輯設計,主要用于通信行業(yè),可以用來模擬和驗證各種通信系統(tǒng),包括無線通信系統(tǒng)、光纖通信系統(tǒng)、數(shù)字信號處理系統(tǒng)等。ModelSim可以幫助用戶發(fā)現(xiàn)硬件設計中的錯誤,以及設計的性能和可靠性。 ModelSim支持多種通信協(xié)議,包括IEEE 802.11、IEEE 802.15.4、IEEE 802.16、IEEE 802.20、IEEE 802.21、IEEE 802.22、IEEE 802.24、IEEE 802.25、IEEE 802.26、IEEE 802.27、IEEE 802.28、IEEE 802.29等?梢杂脕砟M和驗證各種無線通信系統(tǒng),包括無線局域網(wǎng)(WLAN)、無線個域網(wǎng)(WPAN)、無線城域網(wǎng)(WMAN)、無線廣域網(wǎng)(WWAN)等。 ModelSim還可以用來模擬和驗證光纖通信系統(tǒng),包括光纖數(shù)據(jù)鏈路層(FDL)、光纖網(wǎng)絡層(FNL)、光纖傳輸層(FTL)、光纖網(wǎng)絡層(FNL)等。 ModelSim還可以用來模擬和驗證數(shù)字信號處理系統(tǒng),包括數(shù)字信號處理器(DSP)、數(shù)字信號處理器網(wǎng)絡(DSPN)、數(shù)字信號處理系統(tǒng)(DSPS)、數(shù)字信號處理芯片(DSPC)等。 ModelSim可以用來模擬和驗證通信系統(tǒng)中的信號傳輸、信號處理、信號檢測、信號控制、信號接收等功能。此外,ModelSim還可以用來模擬和驗證多種通信協(xié)議,包括IEEE 802.11、IEEE 802.15.4、IEEE 802.16、IEEE 802.20、IEEE 802.21、IEEE 802.22、IEEE 802.24、IEEE 802.25、IEEE 802.26、IEEE 802.27、IEEE 802.28、IEEE 802.29等。 總之,ModelSim是一款功能強大的通信仿真軟件,可以用來模擬和驗證各種通信系統(tǒng),包括無線通信系統(tǒng)、光纖通信系統(tǒng)、數(shù)字信號處理系統(tǒng)等,可以幫助用戶發(fā)現(xiàn)硬件設計中的錯誤,以及設計的性能和可靠性。 Mentor公司的ModelSim是業(yè)界最優(yōu)秀的HDL語言仿真軟件,它能提供友好的仿真環(huán)境,是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù),編譯仿真速度快,編譯的代碼與平臺無關,便于保護IP核,個性化的圖形界面和用戶接口,為用戶加快調(diào)錯提供強有力的手段,是FPGA/ASIC設計的首選仿真軟件。 主要特點: RTL和門級優(yōu)化,本地編譯結(jié)構(gòu),編譯仿真速度快,跨平臺跨版本仿真; 單內(nèi)核VHDL和Verilog混合仿真; 源代碼模版和助手,項目管理; 集成了性能分析、波形比較、代碼覆蓋、數(shù)據(jù)流ChaseX、Signal Spy、虛擬對象Virtual Object、Memory窗口、Assertion窗口、源碼窗口顯示信號值、信號條件斷點等眾多調(diào)試功能; C和Tcl/Tk接口,C調(diào)試; 對SystemC的直接支持,和HDL任意混合 支持SystemVerilog的設計功能; 對系統(tǒng)級描述語言的最全面支持,SystemVerilog, SystemC, PSL; ASIC Sign off。
Mentor公司的ModelSim是業(yè)界最優(yōu)秀的HDL語言仿真軟件,它能提供友好的仿真環(huán)境,是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù),編譯仿真速度快,編譯的代碼與平臺無關,便于保護IP核,個性化的圖形界面和用戶接口,為用戶加快調(diào)錯提供強有力的手段,是FPGA/ASIC設計的首選仿真軟件。 主要特點: RTL和門級優(yōu)化,本地編譯結(jié)構(gòu),編譯仿真速度快,跨平臺跨版本仿真; 單內(nèi)核VHDL和Verilog混合仿真; 源代碼模版和助手,項目管理; 集成了性能分析、波形比較、代碼覆蓋、數(shù)據(jù)流ChaseX、Signal Spy、虛擬對象Virtual Object、Memory窗口、Assertion窗口、源碼窗口顯示信號值、信號條件斷點等眾多調(diào)試功能; C和Tcl/Tk接口,C調(diào)試; 對SystemC的直接支持,和HDL任意混合 支持SystemVerilog的設計功能; 對系統(tǒng)級描述語言的最全面支持,SystemVerilog, SystemC, PSL; ASIC Sign off。
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